【編者按】隨著科學研究與技術開發(fā)市場化功蜓，采用傳統(tǒng)電子設計手段在較短時間內完成復雜電子系統(tǒng)設計毕删，已經越來越難完成了系谐。EDA(EleCTRonICs Design Automation)技術是隨著集成電路和計算機技術飛速發(fā)展應運而生一種高級产舞、快速魂奥。

隨著科學研究與技術開發(fā)市場化，采用傳統(tǒng)電子設計手段在較短時間內完成復雜電子系統(tǒng)設計易猫，已經越來越難完成了耻煤。EDA(EleCTRonICs Design Automation)技術是隨著集成電路和計算機技術飛速發(fā)展應運而生一種高級、快速准颓、有效電子設計自動化工具哈蝇。

1、EDA技術

EDA(電子線路設計座自動化)是以計算機為工作平臺、以硬件描述語言(VHDL)為設計語言炮赦、以可編程器件(CPLD/FPGA)為實驗載體怜跑、以ASIC/SOC芯片為目標器件、進行必要元件建模和系統(tǒng)仿真電子產品自動化設計過程吠勘。EDA是電子設計領域一場革命性芬，它源于計算機輔助設計，計算機輔助制造剧防、計算機輔助測試和計算機輔助工程植锉。利用EDA工具，電子設計師從概念爹舱，算法奕截、協(xié)議開始設計電子系統(tǒng)，從電路設計皿遏，性能分析直到IC版圖或PCB版圖生成全過程均可在計算機上自動完成噪境。EDA代表了當今電子設計技術最新發(fā)展方向，其基本特征是設計人員以計算機為工具丧忍，按照自頂向下設計方法半泪，對整個系統(tǒng)進行方案設計和功能劃分，由硬件描述語言完成系統(tǒng)行為級設計习荚，利用先進開發(fā)工具自動完成邏輯編譯融辈、化簡、分割仁娱、綜合胧蹲、優(yōu)化、布局布線囊祝、仿真及特定目標芯片適配編譯和編程下載殉酬，這被稱為數字邏輯電路高層次設計方法。

1.1伞辛、EDA軟件簡介

“EDA”就是Electronic Design Automation(電子設計自動化)烂翰，也就是能夠幫助人們設計電子電路或系統(tǒng)軟件工具，該工具可以使設計更復雜電路和系統(tǒng)成為可能蚤氏。目前進入我國并具有廣泛影響EDA軟件有：muhisim7甘耿、OW_AD、Protel竿滨、Viewlogio佳恬、Mentor、Synopsys于游、PCBW Id毁葱、Cadence垫言、MicmSim等等，這些軟件各具特色倾剿，大體分為芯片級設計工具筷频、電路板級設計工具、可編程邏輯器件開發(fā)工具和電路仿真工具等幾類;其中Protel是國內最流行前痘、使用最廣泛一種印制電路板設計首選軟件涯馆，由澳大利亞protd Technology公司出品，過去只是用來進行原理圖輸入和PCB版圖設計旋囤，從Protel 98開始别印，加入了模擬數字混合電路仿真模塊和可編程邏輯器件設計模塊戏筹，1999年Protel推出了功能更加強大EDA綜合設計環(huán)境Protel 99凯怕，它將EDA全部內容整合為一體，成為完整EDA軟件缓万，因而該軟件發(fā)展?jié)摿艽笏罹咛厣妥顝姶蠊δ苋允窃韴D輸人和PCB版圖設計。

1.2蔫狰、EDA技術主要內容

EDA技術涉及面很廣催锯，內容豐富，從教學和實用角度看芋妻，主要應掌握如下4個方面內容：一是大規(guī)姆跹可編程邏輯器件;二是硬件描述語言;三是軟件開發(fā)工具;四是實驗開發(fā)系統(tǒng)。其中昭礁，大規(guī)霓嗲猓可編程邏輯器件是利用EDA技術進行電子系統(tǒng)設計載體，硬件描述語言是利用EDA技術進行電子系統(tǒng)設計主要表達手段剪撬，軟件開發(fā)工具是利用EDA技術進行電子系統(tǒng)設計智能化自動設計工具摄乒，實驗開發(fā)系統(tǒng)則是利用EDA技術進行電子系統(tǒng)設計下載工具及硬件驗證工具。

1.3残黑、EDA技術主要特征

1.3.1馍佑、用軟件設計方法來設計硬件

硬件系統(tǒng)轉換是由有關開發(fā)軟件自動完成，設計輸入可以是原理圖VHDL語言梨水，通過軟件設計方式測試拭荤，實現(xiàn)對特定功能硬件電路設計，而硬件設計修改工作也如同修改軟件程序一樣快捷方便疫诽，設計整個過程幾乎不涉及任何硬件舅世，可操作性、產品互換性強踊沸。

1.3.2歇终、基于芯片設計方法

EDA設計方法又稱為基于芯片設計方法，集成化程度更高，可實現(xiàn)片上系統(tǒng)集成评凝，進行更加復雜電路芯片化設計和專用集成電路設計车匪，使產品體積小、功耗低潦号、可靠性高;可在系統(tǒng)編程或現(xiàn)場編程臼裂，使器件編程、重構慨锅、修改簡單便利前肥，可實現(xiàn)在線升級;可進行各種仿真，開發(fā)周期短庐钱，設計成本低淀肿，設計靈活性高。

1.3.3滴图、自動化程度高

EDA技術根據設計輸入文件讯谎，將電子產品從電路功能仿真、性能分析灸室、優(yōu)化設計到結果測試全過程在計算機上自動處理完成乘硬，自動生成目標系統(tǒng)，使設計人員不必學習許多深入專業(yè)知識鹿鳖，也可免除許多推導運算即可獲得優(yōu)化設計成果扁眯，設計自動化程度高，減輕了設計人員工作量翅帜，開發(fā)效率高姻檀。

1.3.4、自動進行產品直面設計

EDA技術根據設計輸入文件(HDL或電路原理圖)藕甩，自動地進行邏輯編譯施敢、化簡、綜合狭莱、仿真僵娃、優(yōu)化、布局腋妙、布線默怨、適配以及下載編程以生成目標系統(tǒng)，即將電子產品從電路功能仿真骤素、性能分析匙睹、優(yōu)化設計到結果測試全過程在計算機上自動處理完成。

1.4撑枯、EDA技術要點

1.4.1顺盆、可編程邏輯器件-PLD

數字邏輯器件發(fā)展直接反映了從分立元件蛹活、中小規(guī)模標準芯片過渡到可編程邏輯器件過程。ISP技術和HDPLD器件使設計人員能夠在實驗室中方便地開發(fā)專用集成數字電路芯片ASIC.當前莹遍，國內外許多著名廠商均已開發(fā)出新一代ISP器件以及相應開發(fā)軟件(如Synario匕磅、EXPERT、Fundation陶啥、MAX Plus2等)晃逞。

1.4.2、“自頂而下”設計方法

10年前眉剿，電子設計基本思路還是選擇標準集成電路“自底向上”(Bottom-Up)地構造出一個新系統(tǒng)虽才。這樣設計方法如同一磚一瓦建造樓房，不僅效率低团何、成本高而且容易出錯寨都，高層次設計給我們提供了一種“自頂向下”(Top-Down)全新設計方法，這種方法首先從系統(tǒng)入手荧孽，在頂層進行功能方框圖劃分和結構設計鸵赫，在方框圖一級進行仿真衣屏、糾錯躏升，并用硬件描述語言對高層系統(tǒng)進行描述，在系統(tǒng)一級進行驗證狼忱，然后用綜合優(yōu)化工具生成具體門電路網表膨疏，其對應物理實現(xiàn)級可以是印刷電路板或專用集成電路，由于設計主要仿真和調試過程是在高層次上完成钻弄，這既有利于早期發(fā)現(xiàn)結構設計上錯誤佃却，避免設計工時浪費，同時也減少了邏輯功能仿真工作量窘俺，提高了設計一次成功率饲帅。

2、數字電路設計

20世紀90年代以來瘤泪，電子信息類產品開發(fā)明顯出現(xiàn)兩個特點：一是產品復雜程度加深;二是產品上市時限緊迫灶泵。隨著計算機性價比提高及可編程邏輯器件出現(xiàn)，對傳統(tǒng)數字電子系統(tǒng)設計方法進行了解放性革命对途，現(xiàn)代電子系統(tǒng)設計方法是設計師自己設計芯片來實現(xiàn)電子系統(tǒng)功能赦邻，將傳統(tǒng)固件選用及電路板設計工作放在芯片設計中進行。然而電路設計本質上是基于門級描述單層次設計(主要以數字電路為主)锉寿，設計所有工作(包括設計輸入轻樟、仿真和分析、設計修改等)都是在基本邏輯門這一層次上進行泣虚，顯然這種設計方法不能適應新形勢舟门，為此引入一種高層次電子設計方法债苍，也稱為系統(tǒng)設計方法。

數字電路設計性本身就是一種綜合性設計锅星，其設計電路中一般包含不同類型電路驹拢，在設計過程中，不可避免地存在許多錯誤和不足如果直接按照這一設計電路在電路板上進行安裝希金、調試帕吆，其結果往往使電路調試費時費力，甚至會引起元器件和儀器設備損壞等問題爵林，導致設計不能達到預期效果觅霉。應用EDA技術在仿真軟件平臺上設計數字電路，能幫助熟悉和掌握最先進電路設計方法和技能臣环。在電子技術高速發(fā)展今天绑警，新器件、新電路不斷涌現(xiàn)央渣，而設計條件受經費等因素制約计盒，一般不能及時更新。采用軟件仿真方法芽丹，在計算機上虛擬一個先進測試儀器北启、元器件品種齊全電子工作臺，可進行驗證性拔第、測試性咕村、設計性等實驗針對性訓練，培養(yǎng)使用計算機及分析蚊俺、應用和創(chuàng)新電路能力懈涛。“以仿代實”泳猬，“以軟代硬”應該成為當代設計發(fā)展潮流之一批钠。

3、基于EDA技術進行數字電路設計研究

EDA技術在數字系統(tǒng)中應用以基于ALTEraEPM7128SLC84-15芯片和MAX PlusII 10.0軟件平臺數字鐘設計為例得封，討論EDA技術在數字系統(tǒng)中具體應用了岸。

3.1、EDA技術設計流程

在設計方法上粤沥，EDA技術為數字電子電路設計領域帶來了根本性變革础估，將傳統(tǒng)“電路設計硬件搭試調試焊接”模式轉變?yōu)樵谟嬎銠C上自動完成。

3.2索射、設計要求

具有時牙德、分、秒虎铅、計數顯示功能庭钢，以24小時循環(huán)計時恋鞋。具有清零和調節(jié)小時、分鐘功能讽钻。具有整點報時功能赵须。

3.3、輸入設計源文件

一個設計項目由一個或多個源文件組成扎矾，它們可以是原理圖文件业嗅、硬件描述語言文件、混合輸入文件唉侄，點擊Source/New菜單咒吐，選擇你所要設計源文件類型，進入設計狀態(tài)属划，完成源文件設計恬叹，存盤、退出;另在一張原理圖編輯器窗口中同眯，通過File/Matching Symbol菜單绽昼，建立一張原理圖符號，生成一個與原理圖文件相同名须蜗、相同功能邏輯宏元件硅确，它自動加到元件列表中，可以在更高層圖紙中反復調用;

3.4唠粥、邏輯編譯

邏輯編譯選擇器件EPM7128SLC84-15疏魏，使用MAX PlusⅡ編譯器編譯設計項目，通過編譯器自動進行錯誤檢查晤愧、網表提取、邏輯綜合蛉腌、器件適配篇瀑，最終產生器件編程文件(。jed)瑟顶。

3.5看剃、綜合

綜合就是利用EDA軟件系統(tǒng)綜合器將VHDL軟件設計與硬件可實現(xiàn)性掛鉤，這是將軟件轉化為硬件電路關鍵步驟鹿腕。綜合器對源文件綜合是針對某一FPGA/CPI D供應商產品系列秋豌。因此，綜合后結果具有硬件可實現(xiàn)性悼锻。EDA提供了良好邏輯綜合與優(yōu)化功能劲旗，它能夠將設計人員設計邏輯級電路圖自動地轉換為門級電路，并生成相應網表文件透辜、時序分析文件和各種報表常孕，若設計沒有錯誤网赤，最終可生成可以編程下載。SOF文件逐会。

3.6族延、器件適配

綜合通過后必須利用FPGA/CPLD布局/布線適配器將綜合后網表文件針對某一具體目標器件進行邏輯映射操作，其中包括底層器件配置献酗、邏輯分割寝受、邏輯優(yōu)化、布局布線等操作罕偎。適配后產生時序仿真用網表文件和下載文件羡蛾，如JED或POF文件。適配對象直接與器件結構細節(jié)相對應锨亏。

3.7痴怨、功能仿真

通常，在設計過程中每一個階段都要進行仿真驗證其正確性器予。在綜合前浪藻，要進行行為仿真，將VHDI源程序直接送到VHDI仿真器中仿真乾翔，此時仿真只是根據VHDI語義進行爱葵，與具體電路沒有關系。綜合后反浓，可利用產生網表文件進行功能仿真萌丈，以便了解設計描述與設計意圖一致性。功能仿真僅對設計描述邏輯功能進行測試模擬峡哥，以了解其實現(xiàn)功能是否滿足原設計要求庭走，仿真過程不涉及具體器件硬件特性，如延遲特性烙昼。時序仿真根據適配后產生網表文件進行仿真荸凸，是接近真實器件運行仿真，仿真過程中已將器件硬件特性考慮進去了泛红，因此仿真精度要高得多一恃。時序仿真網表文件中包含了較為精確延遲信息。

3.8麻镶、編程下載

通過仿真確定設計基本成功后桨檬，即可通過Byteblaster下載電纜線將設計項目以JTAG方式下載到器件中，完成設計所有工作端葵。通過此例設計流程講述可知众凝，EDA技術及其工具在數字電路系統(tǒng)(包括模擬電路系統(tǒng))中正發(fā)揮著越來越重要作用，其應用深度和廣度正在向更深層次延伸年粟。

3.9俭疤、目標系統(tǒng)

用VHDL語言描述編碼電路送丰。譯碼電路用CASE語句完成查表譯碼，其中有近4O種可能情況弛秋。通過求出伴隨式值器躏，把有一個錯誤數據取反糾正過來，其他情況給出信號蟹略，指出有錯誤登失。編譯碼電路選用ALTERA公司生產器件EPF1OK10TC144-3，其中編碼電路占用了32個邏輯單元挖炬，譯碼電路占用了163個邏輯單元揽浙。對編碼譯碼電路做功能仿真。測試使用看來意敛，當數據輸人全為‘1’馅巷，如果總線上傳來數據最后一位出錯。為‘0’草姻，正確數據異或而成數據檢查線DC使得譯碼器能把最后一位改為‘1’;如數據輸人是“00000001”钓猬，編碼器DC為“19”而一旦出現(xiàn)兩個錯誤。如最高位和最低位撩独，譯碼器指示是不可糾正錯誤;如數據正確傳輸草悦，譯碼器指示沒有錯誤。

4匠凤、結束語

目前蝠兽，現(xiàn)代集成電路技術發(fā)展使以現(xiàn)場可編程門陣列為代表大容量可編程邏輯器件等效門數迅速提高，其規(guī)模直逼標準門陣列厂跋，達到了系統(tǒng)集成水平警综。特別是進入二十世紀90年代后，隨著CPLD埂伺、FPGA等現(xiàn)場可編程邏輯器件逐漸興起畴制，VHDL、Verilog等通用性好夭掸、移植性強硬件描述語言普及，ASIC技術不斷完善喊傻，EDA技術在現(xiàn)代數字系統(tǒng)和微電子技術應用中起著越來越重要作用呢烦。從通常意義上來說，現(xiàn)代電子系統(tǒng)設計已經再也離不開EDA技術幫助了褂磕。

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