新思科技40G UCIe IP 全面解決方案為高性能人工智能數(shù)據(jù)中心芯片中的芯片到芯片連接提供全球領(lǐng)先的帶寬

摘要

• 更簡化的解決方案可簡化IP集成：單參考時鐘功能簡化了時鐘架構(gòu)并優(yōu)化了功耗击吱。為便于使用和集成，該IP加快了裸片到裸片鏈路的初始化存妇，無需加載固件男软。

• 芯片健康監(jiān)測增強了多芯片系統(tǒng)封裝的可靠性：為了確保芯片禁微、裸片到裸片以及多芯片系統(tǒng)封裝層面的可靠性，新思科技40G UCIe IP 提供了測試和芯片生命周期管理 (SLM) 功能灯烤。此外恢核，監(jiān)控、測試和修復(fù) IP 以及集成信號完整性監(jiān)控器可實現(xiàn)從設(shè)計到現(xiàn)場的多芯片系統(tǒng)封裝診斷和分析欧蠢。

• 成功的生態(tài)系統(tǒng)互操作性：針對當(dāng)前全新 CPU 和 GPU 的片上互連需求忠宙，新思科技40G UCIe IP 支持業(yè)界廣泛的芯片上互連結(jié)構(gòu)，包括 AXI榴烦、CHI 芯片到芯片杀打、streaming、PCI Express 和 CXL绝壹。為了實現(xiàn)成功的互操作性蕉殴，該 IP 符合 UCIe 1.1 和 2.0 標(biāo)準(zhǔn)，新思科技作為 UCIe 聯(lián)盟的積極成員匿党，協(xié)助推動開發(fā)和推廣以上標(biāo)準(zhǔn)晰绎。

• 預(yù)驗證的設(shè)計參考流程：新思科技UCIe IP與新思科技的3DIC Compiler(一個統(tǒng)一的從探索到簽收平臺)的組合可用于新思科技的預(yù)驗證設(shè)計參考流程，該流程包括所有必要的設(shè)計輔助工具括丁，如自動布線流程荞下、內(nèi)插研究和信號完整性分析。

• 適用于多芯片系統(tǒng)設(shè)計的廣泛 IP 解決方案：除了 UCIe IP 和高速 SerDes史飞，新思科技還提供 HBM3 和 3DIO IP尖昏，以實現(xiàn)大容量存儲器和 3D 封裝。

上市時間和可用資源

新思科技40G UCIe IP 將于 2024 年底推出构资，適用于多種晶圓代工廠及其工藝抽诉。

• 產(chǎn)品解決方案: 新思科技UCIe IP 解決方案

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關(guān)于新思科技

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（美通社）

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